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标题: 联想Y430屏供电 [打印本页]

作者: chenwanjian 时间: 2013-10-15 22:30
标题: 联想Y430屏供电
+LCDVDD是+3VS通过Q3导通产生的，可是Q1起的是什么作用呀，GM_ENVDD和VGA_ENVDD又是没有的，图纸上是这么标记的，+5VALW给Q2的2脚一个高电平会把+LCDVDD拉低吗，这个模块有点乱，大家帮忙分析一下

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作者: 苦笑着释怀 时间: 2013-10-15 22:46
你想复杂了。 R2 R3 那里是，分独显和集显。肯定有的。Q1就是复杂拉低Q3G 产生屏供电

作者: chenwanjian 时间: 2013-10-15 23:09

苦笑着释怀发表于 2013-10-15 22:46

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你想复杂了。 R2 R3 那里是，分独显和集显。肯定有的。Q1就是复杂拉低Q3G 产生屏供电

原来，R2 R3是存在的，因为没有实物，就单纯的没事看看电路图，谢谢高手提点

作者: userful 时间: 2013-10-15 23:39
Q1导通，拉低Q2 Q3G级，Q2是N管截止，Q3是P管导通，就产生屏供电了啊。

作者: chenwanjian 时间: 2013-10-15 23:42

userful 发表于 2013-10-15 23:39

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Q1导通，拉低Q2 Q3G级，Q2是N管截止，Q3是P管导通，就产生屏供电了啊。

只要是我一开始误以为R2和R3是不存在的，原来是我想错了

作者: 雪花无情 时间: 2013-10-15 23:44
要想产生屏的供电，Q3须导通，Q2须截止，Q3为P沟道的MOS管，Q2为N沟道MOS管。所以就须要它们的G极为低电平才行。要想得到这个低电平又须要Q1导通如地将这个电压拉低，Q1为N沟道的三极管。要想导通须G极为高电平，所以Q1 G极的GM_ENVDD和VGA_ENVDD二个信号须有一个为高电平才行

作者: chenwanjian 时间: 2013-10-15 23:51

雪花无情发表于 2013-10-15 23:44

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要想产生屏的供电，Q3须导通，Q2须截止，Q3为P沟道的MOS管，Q2为N沟道MOS管。所以就须要它们的G极为低电平才 ...

谢谢哥们帮忙分析

作者: 向展宏图 时间: 2013-10-16 00:30
楼主是没有注意看管是属于什么型的吧。注意的话是很容易分析出来的

作者: userful 时间: 2013-10-16 13:06

chenwanjian 发表于 2013-10-15 23:42

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只要是我一开始误以为R2和R3是不存在的，原来是我想错了

元件名称前面打@ *才是没用料吧。

作者: userful 时间: 2013-10-16 13:13

chenwanjian 发表于 2013-10-15 23:42

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只要是我一开始误以为R2和R3是不存在的，原来是我想错了

元件名称前面打@ *才是没用料吧。

作者: chenwanjian 时间: 2013-10-16 18:41

userful 发表于 2013-10-16 13:13

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元件名称前面打@ *才是没用料吧。

嗯，这回注意了，平四看到@ *我都会很快忽略的

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